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Technische Regel [AKTUELL] 2023-07

EIA JEP 166E:2023-07
JC-42.6 Manufacturer Identification (ID) Code for Low Power Memories
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Technische Regel [AKTUELL] 2021-03

EIA JEP 300-1:2021-03
NEAR-TERM DRAM LEVEL ROWHAMMER MITIGATION
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Norm [AKTUELL] 2011-10

EIA JESD 79-3-2:2011-10
1.25 V DDR3U-800, DDR3U-1066, DDR3U-1333, and DDR3U-1600
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Norm [AKTUELL] 2021-02

EIA JESD 79-4-1B:2021-02
Addendum No. 1 to JESD79-4, 3D Stacked DRAM
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Norm [AKTUELL] 2021-07

EIA JESD 79-4D:2021-07
DDR4 SDRAM
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Norm [AKTUELL] 2022-09

EIA JESD 79-5B:2022-09
DDR5 SDRAM
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Norm [AKTUELL] 2023-01

EIA JESD 82-6A.01:2023-01
Definition of the SSTV32852 2.5-V 24-Bit to 48-Bit SSTL 2 Registered Buffer for 1U Stacked DDR DIMM Applications
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Norm [AKTUELL] 2023-01

EIA JESD 82-7A.01:2023-01
Definition of the SSTU328641.8-V Configurable Registered Buffer for DDR2 RDIMM Applications
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Norm [AKTUELL] 2023-01

EIA JESD 82-12A.01:2023-01
Definition of the SSTU32S869 and SSTU32D869 Registered Buffer with Parity for DDR2 RDIMM Applications
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Norm [AKTUELL] 2023-02

EIA JESD 82-13A.01:2023-02
Definition of the SSTVN16859 2.5-2.6 V 13-Bit to 26-Bit SSTL 2 Registered Buffer for PC1600, PC2100, PC2700, and PC3200 DDR DIMM Applications
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Norm [AKTUELL] 2006-10

EIA JESD 82-14A:2006-10
Definition of the SSTUB32868 1.8 V Configurable Registered Buffer with Parity for DDR2 RDIMM Applications
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Norm [AKTUELL] 2023-01

EIA JESD 82-17.01:2023-01
Definition of the SSTUA32S868 and SSTUA32D868 Registered Buffer with Parity for 2R×4 DDR2 RDIMM Applications
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Norm [AKTUELL] 2007-01

EIA JESD 82-18A:2007-01
Standard for Definition of CUA877 and CU2A877 PLL Clock Drivers for for Registered DDR2 DIMM Applications
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Norm [AKTUELL] 2023-01

EIA JESD 82-20A.01:2023-01
FBDIMM Advanced Memory Buffer (AMB)
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Norm [AKTUELL] 2007-01

EIA JESD 82-21:2007-01
Standard for Definition of CUA845 PLL Clock Driver for Registered DDR2 DIMM Applications
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Norm [AKTUELL] 2023-01

EIA JESD 82-22.01:2023-01
Instrumentation Chip Data Sheet for FBDIMM Diagnostic Senselines
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Norm [AKTUELL] 2023-01

EIA JESD 82-23.01:2023-01
Definition of the SSTUA32S869 and SSTUA32D869 Registered Buffer with Parity for DDR2 RDIMM Applications
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Norm [AKTUELL] 2023-01

EIA JESD 82-24.01:2023-01
Definition of the SSTUB32865 28-bit 1:2 Registered Buffer with Parity for DDR2 RDIMM Applications
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Norm [AKTUELL] 2023-01

EIA JESD 82-25.01:2023-01
Definition of the SSTUB32866 1.8 V Configurable Registered Buffer with Parity Test for DDR2 RDIMM Applications
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Norm [AKTUELL] 2023-01

EIA JESD 82-26.01:2023-01
Definition of the SSTUB32868 Registered Buffer with Parity for 2R x4 DDR2 RDIMM Applications
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Norm [AKTUELL] 2023-03

EIA JESD 82-27.01:2023-03
Definition of the SSTUB32869 Registered Buffer with Parity for DDR2 RDIMM Applications
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Norm [AKTUELL] 2023-03

EIA JESD 82-28A.01:2023-03
Fully Buffered DIMM Design for Test, Design for Validation (DFx)
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Norm [AKTUELL] 2022-09

EIA JESD 82-29A.01:2022-09
Definition of the SSTE32882 Registering Clock Driver with Parity and Quad Chip Selects for DDR3/DDR3L/DDR3U RDIMM 1.5 V/1.35 V/1.25 V Applications
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Norm [AKTUELL] 2023-01

EIA JESD 82-30.01:2023-01
LRDIMM DDR3 Memory Buffer (MB)
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Norm [AKTUELL] 2023-01

EIA JESD 82-31A.01:2023-01
DDR4 Registering Clock Driver Definition (DDR4RCD02)
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Norm [AKTUELL] 2016-11

EIA JESD 82-32:2016-11
DDR4 Data Buffer Defintion (DDR4DB01)
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Norm [AKTUELL] 2021-12

EIA JESD 82-521:2021-12
DDR5 DATA BUFFER DEFINITION (DDR5DB01)
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Norm [AKTUELL] 2019-01

EIA JESD 84-B51A:2019-01
Embedded Multi-Media Card (eMMC) Electrical Standard (5.1A)
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Norm [AKTUELL] 2024-06

EIA JESD 209-4E:2024-06
Low Power Double Data Rate 4 (LPDDR4)
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Norm [AKTUELL] 2023-06

EIA JESD 209-5C:2023-06
Low Power Double Data Rate (LPDDR) 5/5X
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